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uvm1.2与uvm1.1的区别

上一篇 / 下一篇  2016-06-01 17:42:46 / 个人分类:UVM notebook

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1.关于在seuqnce中raise/drop objection

]U9g+rA5n/Z t[*KX ~0ET创芯网(EETOP)-电子设计论坛、博客、超人气的电子工程师资料分享平台4o^y'PO6l

T-M-D,copy下面这段话居然有危险字符

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6[)F u1NT;~Z~0ET创芯网(EETOP)-电子设计论坛、博客、超人气的电子工程师资料分享平台"^%`jjm!xq{
uvm1.2不建议user自己去在sequence中手动去raise/drop objection,所以在uvm1.1中的经典写法在1.2中就有问题.ET创芯网(EETOP)-电子设计论坛、博客、超人气的电子工程师资料分享平台+q{#dK:J}

如 下所示(虽然被set到default_sequence的top sequence还有starting_phase这个变量,但是null的。1.2中建议用 set_automatic_phase_objection,如果非要手动去做,在调用starting_phase时可以先用 get_starting_phase去get到starting_phase):ET创芯网(EETOP)-电子设计论坛、博客、超人气的电子工程师资料分享平台 Ds4_s;Cq

ET创芯网(EETOP)-电子设计论坛、博客、超人气的电子工程师资料分享平台!FT!v __M0QO

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