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Interlaken PCS 16bits SERDES interface

已有 828 次阅读| 2010-10-18 23:20 |个人分类:参考设计

Specification

1.      Compliant with the Interlaken Protocol Definition, Rev 1.2

       2.   64/67 encoding and decoding

3.   Automatic word alignment

4.   Self-synchronizing data scrambler

5.   CRC32 generation and checking for lane data integrity

6.   Serdes Interface 16bits

Status

1.      RTL verilog source code completed

2.        Verification completed

3.    FPGA synthesis, place and route completed

       4.    Document completed

Contact

Email: hpiclab@sina.com


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