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Configuring a Test Environment(从Configuration开始)

已有 560 次阅读| 2018-12-12 16:56 |系统分类:芯片设计

Configuration

      了解将配置传递到UVM测试环境
Configuration Chapter contents:
     Configuration(本页) - 如何使用配置值和配置对象;
       Config/ConfiguringSequences - 如何配置序列;
       Resources/config db - 如何使用uvm_config_db存储和加载配置对象;
       Config/Params Package - 好的做法是将所有配置参数封装在一个包中,以便从外部和内部仿真中轻松访问;
       ParametersAndReuse - 一篇高质量的文章,讨论如何通过测试平台传递参数;
       Config/Container - Mentor不推荐使用OVM容器解决方案 - 请改用uvm_config_db API;
       Config/SetGetConfig - Mentor不推荐使用OVM set / get配置解决方案 - 使用uvm_config_db API;
Topic Overview

Introduction

       设计可重用测试平台的关键原则之一是使测试平台尽可能配置。这样做意味着测试平台及其组成部分能很容易的被重用和很快的被修改。
       在测试平台中,您通常可以将许多不同含义的数值以一个特定名字定义 - 诸如for-loop限制,字符串名称,随机化权重和其他约束表达式值,coverage bin值等值。这些值可以由SystemVerilog变量表示,可以在runtime阶段设置(和更改),也可以在SystemVerilog参数中表示,这些参数必须在编译时设置。由于它们提供的灵活性,应尽可能始终使用封装到配置对象中并使用uvm_config_db API访问的变量。
       但是,总线宽度必须在编译时固定,因此它不能在配置对象里定义实现。有许多关于处理UVM中参数的文章: 

  •  参数化测试显示如何使用UVM工厂进行参数化测试;
  • 关于测试参数package的文章展示了如何集中DUT和testbench之间共享的参数;
  • 关于参数和重用的文章显示了如何通过uvm_component层次结构传递大量参数。
         


           

           

          

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