1.PR后的timing rpt没有时序违反,那sdf里负的hold 是什么意思,是好是坏? setup,hold的本质是数据不能在clock变化的周围变化, 否则会出错, 把在clock前的叫setup, clock后的叫hold, 其实是一个窗口 (violation window). 但是由于一个触发器内部本身也有delay, 假如data path没delay, clock path有delay, 那 ...
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