配置好Python3.6和pip3 安装EPEL和IUS软件源 yuminstallepel-release-y yuminstallhttps://centos7.iuscommunity.org/ius-release.rpm-y yuminstallpython36u-y ln-s/bin/python3.6/bin/python3 安装pip3 yuminstallpython36u ...
今天在新装Ubuntu的机器上安装python,make Install失败了,报错zlib not available, 在网上找到了大神的解决办法,记录在这里。 错误: zipimport.ZipImportError: can't decompress data; zlib not available Makefile:1079: recipe for target 'install' failed make: *** Error 1 解决办法:安装依赖 ...
下面有一段verilog代码和仿真文件,用的是VCS仿真和编译工具。我们来研究一下不同的驱动赋值方式对仿真结果的影响。下面我把我做的例子和大家分享一下。 设计源代码如下: `timescale 1ns/1ps module counter (data_out0, data_out1,clk,rst_n, data_in0, data_in1); output data_out0 ...
alias cd 'cd \!*; ls; pwd' 这个alias改变cd的默认工作方式,让cd命令在进入指定的目录后,自动运行ls命令对本目录下的文件及目录列表,之后运行pwd,显示当前在哪个目录中。不过,\!*,这几个变量的意义,寻找了好久,始终不知道其意义。 ...
今天顺利的在centos 5.5 32位系统下安装ISE13.3,安装完毕,根据安装之后的窗口提示运行settings32.sh之后,设置好环境变量 setenv XILINX /tools/Xilinx/13.3 setenv PATH $PATH:$XILINX/ISE_DS/ISE/bin/lin 之后重新source ~/.cshrc,然后敲ise发现根本无法启动。 网上找了一遍之后,发现原来是 ...
声明:本文引用来源网络,其版权属于署名者所有,转载请注明署名 Rick Collins, 美国马里兰州 虽然5V电源逻辑在很多应用中仍很常见,但大多数 FPGA 都支持3.3V以及更低的接口电平。FPGA应用说明通常建议,当把一只FPGA连接到较高电压电平时,FPGA的I/O块中要用PCI(外设部件互连)总线箝位二极管,并外接一只 ...
引:今天看到一个奇怪的问题,记录下来吧。 问题:假如你的设计采用了早期的ISE版本,比如3.1之前的软件。整个设计又是基于schematic原理图的方式。那么好了,现在新的ISE软件没办法打开这么早期的ISE原理图和工程文件。如何解决呢? 解答:在网上搜索了一下,居然有老外早就发现这个问题了。人家提出的解决方法是: ...
今天看到一个问题如下: 在生成位流文件的时候,显示的警告如下: Clock net u8/dout_not 0001 is sourced by a combinatorial pin.This is not good design practice.Use the CE pin to control the loading of data into the flip-flop. 回复: 报告的warning和这个模块看起来没关系,至少从你贴的 ...
引:不怎么做DSP方面的算法,所以其实我对于浮点和定点数据运算没有什么概念。但是今天在论坛上看到一段代码,这段代码倒是给我一些启发。乍一看好像不对,但是仔细分析来看,功能又是正确的。其实是利用verilog和芯片中关于定点和浮点的转变罢了。或许对于常年和这些概念打交道的人来说,小菜一碟,但是对于我,还挺有用 ...
最近发现自己RTLdesign的一个bug,都要tapeout了,post-layout才发现。虽然不是critical的bug,但是的确是我设计中的一个疏忽。 慢速时钟下的一个信号,需要跨越到一个快速时钟去采样。结果这个控制信号没有同步过去,快速时钟直接拿来使用了。 后果很严重,post-layout simulation 发现亚稳态/不完全采样。 以后 ...
cheyle
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hebut_wolf
改造人汽水侠2号
冰点火龙
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